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dsPIC33FJXXXMCX06A/X08A/X10A
FIGURE 1-1:
PSV and Table
Data Access
Control Block
dsPIC33FJXXXMCX06A/X08A/X10A GENERAL BLOCK DIAGRAM
Y Data Bus
Interrupt
Controller
X Data Bus
PORTA
8
16
16
16
16
DMA
23
Data Latch
Data Latch
RAM
23
23
PCU PCH PCL
Program Counter
Stack Loop
Control Control
Logic Logic
X RAM
Address
Latch
16
Y RAM
Address
Latch
16
DMA
Controller
16
PORTB
Address Latch
Address Generator Units
PORTC
Program Memory
EA MUX
Data Latch
24
Instruction
Decode and
Control
ROM Latch
Instruction Reg
16
16
16
PORTD
PORTE
Control Signals
to Various Blocks
DSP Engine
OSC2/CLKO
OSC1/CLKI
Timing
Generation
FRC/LPRC
Oscillators
Power-up
Timer
Oscillator
Start-up Timer
Power-on
Divide Support
16 x 16
W Register Array
16
PORTF
Reset
Precision
Band Gap
Reference
Voltage
Regulator
V CAP
Watchdog
Timer
Brown-out
Reset
V DD , V SS
MCLR
16-Bit ALU
16
PORTG
PWM
QEI
Timers
1-9
ADC1,2
ECAN1,2
IC1-8
OC/
PWM1-8
CN1-23
SPI1,2
I2C1,2
UART1,2
Note:
Not all pins or features are implemented on all device pinout configurations. See pinout diagrams for the specific pins
and features present on each device.
DS70594D-page 14
? 2009-2012 Microchip Technology Inc.
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